Matthias Däumler

Angestellt, Engineer Design & Verification, eesy-ic GmbH
Erlangen, Deutschland

Fähigkeiten und Kenntnisse

SoC Design und Verifikation
ASIC Design und Verifikation
FPGA Design und Verifikation
Verifikation
komplexe digitale Designs
embedded Processor und IP Support
Design und Verifikation in SystemVerilog
Test environments
Test suits
RTL code review und Qualitätscheck
VHDL
Verilog
SystemVerilog
UVM
FPGA
Xilinx
Mentor QuestaSim
Xilinx Vivado
Virtex-7
Synopsys Synplify
Spyglass
FPGA Evaluierung
Prototyping

Werdegang

Berufserfahrung von Matthias Däumler

  • Bis heute 10 Jahre und 10 Monate, seit Okt. 2014

    Engineer Design & Verification

    eesy-ic GmbH

  • 3 Jahre, Nov. 2011 - Okt. 2014

    Senior Engineer

    Fraunhofer Institut IIS, Erlangen

    ASIC Design und Verifikation, FPGA Evaluation, Digital Systems Group

  • 9 Jahre und 10 Monate, Feb. 2002 - Nov. 2011

    wissenschaftl. Mitarbeiter

    Fraunhofer Institut IIS, Dresden

    Prototyp-Entwicklung Hardware, Entwurf und Test

  • 7 Monate, März 2001 - Sep. 2001

    Design and Test Engineer

    Infineon Technologies AG München

    Test and Product Engineering

  • 9 Monate, Juni 1999 - Feb. 2000

    Diplomant

    Infineon Technologies AG München

    Diplomarbeit und zweimonatige Mitarbeit im Anschluß an DA

  • 2 Monate, Juli 1998 - Aug. 1998

    Student

    Siemens AG München

    Hauptpraktikum Abteilung ZT ME 5 Bereich Mikroelektronik, Zentralabteilung Technik

  • 3 Monate, Apr. 1998 - Juni 1998

    Student

    Siemens AG Erlangen

    Hauptpraktikum Abteilung A&D Entwicklungsabteilung für Kombinationstechnik

Ausbildung von Matthias Däumler

  • 6 Jahre und 2 Monate, Nov. 1993 - Dez. 1999

    Elektrotechnik

    Friedrich-Alexander Universität Erlangen-Nürnberg

    Mikroelektronik

Sprachen

  • Deutsch

    Muttersprache

  • Englisch

    Gut

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