Robert Inderst
Angestellt, Senior FPGA System Designer, SVS-VISTEK GmbH
München, Deutschland
Fähigkeiten und Kenntnisse
Werdegang
Berufserfahrung von Robert Inderst
- Bis heute 6 Jahre und 8 Monate, seit Okt. 2018
Principal Engineer Hardware
Infinera
Technical project lead of HW design pojects. Experiance in all steps of ASIC, FPGA and SoC design
- 5 Jahre und 5 Monate, Mai 2013 - Sep. 2018
FPGA Design und technischer Projektleiter
Coriant R&D GmbH
- 6 Jahre und 1 Monat, Apr. 2007 - Apr. 2013
FPGA Technischer Projektleiter
NSN Optical GmbH
- 14 Jahre und 6 Monate, Okt. 1992 - März 2007
HW Entwickler
Siemens AG (verschiedene Bereiche)
HW/ASIC/FPGA/ Entwickler, techn. Projektleiter,
- 5 Monate, Mai 1992 - Sep. 1992
ASIC Design
Siemens AG
Ausbildung von Robert Inderst
- 4 Jahre und 7 Monate, Sep. 1987 - März 1992
Elektrotechnik
Fachhochschule München
Datentechnik
Sprachen
Deutsch
Muttersprache
Englisch
Fließend
Französisch
-
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