Bradley M. Weber

Angestellt, Senior Analog / Mixed-Signal Design Engineer, Qimonda AG
Neubiberg, Deutschland

Fähigkeiten und Kenntnisse

A strong background in analog and digital circuit

Werdegang

Berufserfahrung von Bradley M. Weber

  • Bis heute 24 Jahre, seit Aug. 2001

    Senior Analog / Mixed-Signal Design Engineer

    Qimonda AG

    • Currently developing GDDR3 / GDDR5 High-speed Graphics Memories (5 separate designs) which are currently the fastest DRAMs on the market. • 9+ Years of broad experience in both Analog and Digital CMOS circuit design within full-custom and semi-custom design environments • Adept, pro-active and extremely versatile design engineer who has experience with RTL and transistor level design, layout, extraction and simulation debug • Recently designed High-speed Data and Clock paths and Analog power system

  • 5 Monate, Aug. 2000 - Dez. 2000

    Digital Design Engineer

    Infineon Technologies
  • 4 Monate, Sep. 1999 - Dez. 1999

    Analog Design Engineer

    PMC Sierra

  • 5 Monate, Jan. 1999 - Mai 1999

    DRAM Design Engineer

    Infineon Technologies / Siemens Semiconductors

  • 6 Monate, Apr. 1998 - Sep. 1998

    Digital Design Engineer

    Tundra Semiconductors

Ausbildung von Bradley M. Weber

  • 5 Jahre und 10 Monate, Sep. 1995 - Juni 2001

    Electrical Engineering

    University Of Waterloo

    - Analog Circuit Design - 7 completed Internships (4 months each in duration) - MEMs Research Assistant 2001

Sprachen

  • Englisch

    Muttersprache

  • Deutsch

    Gut

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