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Java Heera Rajagari

Angestellt, DESIGN VERIFICATION ENGINEER, AMD
Hyderabad, Indien

Fähigkeiten und Kenntnisse

SystemVerilog (SV) Universal Verification Methodology (UVM)
C Perl Shell Scripting
AMBA (AXI APB AVS) NVMe I2C PCI Express (PCIe) interfaces
Synopsys VCS Synopsys Verdi Cadence Tools Xilinx ISE
GitHub Perforce icmp4 JIRA
SLAI
GitHub
COPILOT

Werdegang

Berufserfahrung von Java Heera Rajagari

  • Bis heute 1 Jahr und 10 Monate, seit Feb. 2025

    DESIGN VERIFICATION ENGINEER

    AMD

Sprachen

  • Englisch

    C2 (Verhandlungssicher / Muttersprachlich)

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