Nagy Laszlo
Bis 2009, VLSI Design/Verification Engineer, Fast HDL
Brasov, Romania
Fähigkeiten und Kenntnisse
Werdegang
Berufserfahrung von Nagy Laszlo
- Current 17 years and 1 month, since May 2009
VLSI Design/Verification Engineer
EtherGate
ASIC and FPGA targeted Verilog block design IP core integrations Verilog/SystemVerilog based verification
- 3 years and 2 months, Mar 2006 - Apr 2009
VLSI Design/Verification Engineer
Fast HDL
ASIC and FPGA targeted Verilog block design IP core integrations Verilog/SystemVerilog based verification
Ausbildung von Nagy Laszlo
- 4 years and 9 months, Oct 2001 - Jun 2006
Applied Electronics
Transilvania University Brasov
Sprachen
English
B1-B2 (Gute Kenntnisse)
Romanian
C1 (Fließend)
Hungarian
C2 (Verhandlungssicher / Muttersprachlich)
German
A1-A2 (Grundkenntnisse)
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