Neel Patel

Fähigkeiten und Kenntnisse

Computer Architecture
Analog Circuit Design
Analog Integrated Circuit Design
DFT
Internet of Things (IoT)
Application-Specific Integrated Circuits (ASIC)
Digital Circuit Design
Logic Design
Automatic Test Pattern Generation (ATPG)
Digital Designs
LoRaWAN
Circuit Design
Digital Electronics
Place & Route
System on a Chip (SoC)
Clock Tree Synthesis
Digital IC Design
System Verilog
RTL Coding
EDT
SystemVerilog
RTL Design
Embedded C
The Things Network(TTN)
RTL Development
Field-Programmable Gate Arrays (FPGA)
Verilog
SCAN
Hardware Architecture
Verilog HDL
Scan Insertion
Very-Large-Scale Integration (VLSI)
Static Timing Analysis
Xilinx
Xilinx Vivado

Werdegang

Berufserfahrung von Neel Patel

  • 7 Monate, Feb. 2025 - Aug. 2025

    DFT Intern

    eInfochips (An Arrow Company)

    • Implemented Scan Insertion, ATPG, and EDT Insertion for an I2C design, optimizing test coverage and fault simulation. • Utilized industry-standard tools like Tessent, DFT Compiler, and TestKompress to collaborate with RTL and backend teams. • Achieved increased test coverage and fault simulation accuracy for the I2C design at eInfochips.

  • 2 Monate, Mai 2024 - Juni 2024

    ASIC Intern

    eInfochips (An Arrow Company)

Ausbildung von Neel Patel

  • Bis heute 1 Jahr und 9 Monate, Feb. 2026 - Okt. 2027

    Master of Science

    Deggendorf Institute of Technology

  • 4 Jahre, Aug. 2021 - Juli 2025

    Bachelor of Technology - BTech

    Nirma University, Ahmedabad, Gujarat, India

Sprachen

  • Deutsch

    A1-A2 (Grundkenntnisse)

  • Englisch

    C1 (Fließend)

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