Philipp Kadletz

Abschluss: MSc, UAS Technikum Wien
Vienna, Austria

Fähigkeiten und Kenntnisse

SystemVerilog
UVM
VHDL
C
Python
Quartus
Verilog
Synopsys-Spyglass-Lint
Synopsys VCS
ptMTL
ptLTL

Werdegang

Berufserfahrung von Philipp Kadletz

  • Current 12 years and 10 months, since Aug 2013

    Digital Verification Engineer

    IMS Nanofabrication AG

  • 5 months, Mar 2011 - Jul 2011

    Trainee

    Frequentis

Ausbildung von Philipp Kadletz

  • 9 months, Oct 2011 - Jun 2012

    Electronic and Electrical Engineering Erasmus Student

    Loughborough University

  • 3 years and 10 months, Sep 2011 - Jun 2015

    Embedded Systems

    UAS Technikum Wien

    Application Specific Integrated Circuit (ASIC) Engineering, Embedded System Verification, Validation and Verification, Fundamentals of Digital Signal Processing

  • 2 years and 10 months, Sep 2008 - Jun 2011

    Electronics

    UAS Technikum Wien

Sprachen

  • English

    C1 (Fließend)

  • German

    C2 (Verhandlungssicher / Muttersprachlich)

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