SaratChandra Mandapati
Fähigkeiten und Kenntnisse
Werdegang
Berufserfahrung von SaratChandra Mandapati
FPGA Programming
- 7 months, Aug 2012 - Feb 2013
Hardware designer
identigo GmbH
- 7 months, Sep 2011 - Mar 2012
Master Thesis
Fraunhofer
The thesis task involved implementation of CAN controller protocol on FPGA (Verilog),implementation of transceiver add-on board using Eagle CAD, implementation of Nios ii embedded processor using Altera system build tools and programming Nios ii processor.
- 3 months, Jun 2011 - Aug 2011
Student Job
HOSCHULE DARMSTADT
Designing Driver code for LCD display in VHDL, for Xilinx Vertex 5 board
- 4 months, Mar 2011 - Jun 2011
Lab tutor
HOSCHULE DARMSTADT
I was the Lab assistant in Digital design Lab For Master Students. Tools used: Xilinx ISE, Plan Ahead, EDK.
- 6 months, Dec 2009 - May 2010
Intern
CASED
Implementing and testing RSA cryptography algorithm on Xilinx Spartan 3E FPGA board.
- 9 months, Oct 2006 - Jun 2007
IT Associate
Institute for Electronic Governance
Designing websites for state government.
Ausbildung von SaratChandra Mandapati
- 3 years and 7 months, Sep 2008 - Mar 2012
Microelectronics
Hochschule Darmstadt
Digital designing using VHDL,VLSI technology.
Sprachen
English
B1-B2 (Gute Kenntnisse)
German
A1-A2 (Grundkenntnisse)
Three Indian Languages Telugu mother tongue
Tamil and Hindi
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