
Thomas Lauer
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Fähigkeiten und Kenntnisse
Werdegang
Berufserfahrung von Thomas Lauer
- Current 10 years and 5 months, since Jan 2016
Director Patent Examiner
DPMA
- 5 years, Jan 2011 - Dec 2015
Patent Examiner
DPMA
Examining national and international patent applications; dynamo electrical machines, power electronics and control engineering; sensors
FPGA Design in VHDL; Design and Layout of PCB-boards particularly processor board with Freescale PowerPC architecture; PCI Express IP-core embedding in Xilinx and Altera design environments; High-speed transceiver design; Enbedded hardware und software based on QNX realtime operating system; Verification, testing and start-up; Writing of testing applications in C; configuration management; PCAD, Xilinx ISE, Altera Quartus, Eclipse, QNX
- 2 years and 11 months, Nov 2004 - Sep 2007
Engineering Consultant
Alten GmbH im Aufrag der Infineon Technologies AG
Behavioural modeling of Infineon power MOS-FET IC's for designers and external customers; VHDL-AMS modeling library; PSpice; Verification, simulation, customer support; Design methodology
Ausbildung von Thomas Lauer
- 6 years and 1 month, Oct 1998 - Oct 2004
Elektrotechnik und Informationstechnik
RWTH-Aachen
Mikroelektronik
Sprachen
German
C2 (Verhandlungssicher / Muttersprachlich)
English
C1 (Fließend)
French
B1-B2 (Gute Kenntnisse)
Chinese
A1-A2 (Grundkenntnisse)
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