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Arunprasad Vijayaraghavan

Angestellt, Wissenschaftlicher Mitarbeiter, Institut Für Navigation Uni Stuttgart
Stuttgart, Deutschland

Fähigkeiten und Kenntnisse

VHDL
C
FPGA
CPLD
MatLab
Simulink
C++
Embedded Systems
Lattice Diamond
Xilinx ISE
Altera Quartus
ModelSim
Embedded Software
Digital signal processing
Optical
Signal Processing
Circuit design
Embedded microcontroller
vivado
RTL development and verification for ASICS and FPG
verilog

Werdegang

Berufserfahrung von Arunprasad Vijayaraghavan

  • Bis heute 6 Jahre und 2 Monate, seit März 2019

    Wissenschaftlicher Mitarbeiter

    Institut Für Navigation Uni Stuttgart

  • 9 Monate, Dez. 2017 - Aug. 2018

    Master Thesis Student

    Teleconnect GmbH

    Research and Development in improving the optical camera communication (VLC) transmission methods (modulation, FEC, synchronization ...). MATLAB-based simulation platform for selecting suitable transfer methods. Deriving the requirements for smartphone app creation and setup CPLD-based demonstrator, the unidirectional transmission using OCC. VHDL is used for CPLD design.

  • 5 Monate, Mai 2017 - Sep. 2017

    Internship

    Teleconnect GmbH

    Worked in Visible Light Communication. MachXO3 (Lattice CPLD) is used for programming. CPLD design is done in VHDL. Data bits are modulated according to the specific specification and send through RGB LED. Different CPLD design where done in different specification during the internship period based on Visible Light Communication. Additionally arduino C program was analyzed and developed in VHDL . Reverse engineering work was done (VHDL code was developed according to the output waveform).

  • 6 Monate, Jan. 2017 - Juni 2017

    Praktikant

    TU Chemnitz

    • Arbeitete in der Kamera-basierten Anwendung für die Automobilindustrie • FPGA-basiertes Modul wurde für die automatische Belichtungskontrolle entwickelt • die Anwendung wurde in Zynq und MicroBlaze implementiert • Erfahrung in der Arbeit mit Xilinx SDK • I2C-Kommunikation wurde implementiert, um die CMOS-Sensor Registerwerte zu schreiben und zu lesen • Vivado Design Suite wird für die Entwicklung verwendet • Erfahrung im AXI-Bus und Interrupt-Handling

  • 3 Monate, Okt. 2016 - Dez. 2016

    project

    TU Chemnitz

    • RTL verification for ASICS and FPGA • Detecting bug in the design by running the test case • Understanding the test case written for microcontroller interfaced with FPGA (C language for microcontroller, Verilog for FPGA) • Vivado design suite is used to run the test case • Issue solved by simulation result and generated netlist

  • 6 Monate, Juni 2016 - Nov. 2016

    Research Project

    TU Chemnitz

    Comparision of Low cost FPGA families ( ECP5, ARTIX 7, CYCLONE V ) Project descriptionModelling of Calculator(VHDL) and implementation in FPGAs(ECP5, Atrix7, Cyclone V) Comparison of FPGA - Hardware & Simulation (ECP5, Atrix7, Cyclone V) Comparison of Design tools (Xilinx ISE, Lattice Diamond, Altera Quartus) Modelling of Barcode scanner(VHDL) Implementation of Digital stopwatch in VHDL (Modelsim 6.1d)

Ausbildung von Arunprasad Vijayaraghavan

  • Bis heute 11 Jahre und 4 Monate, seit Jan. 2014

    Masters in Micro and Nano systems

    Technische Universität Chemnitz

    I learned many things regarding the Electronics fields by a suitable combination of programming with theoretical and practical knowledge : - System Design - Microsystem design - Micro and Nono device - Advanced Integrated circuit design - Smart sensor systems - Automotive sensor systems

  • 2008 - 2012

    Bachelor’s Degree in Electronics and Communications Engineering

    Anna University, Chennai

Sprachen

  • Deutsch

    Gut

  • Englisch

    Muttersprache

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