Ashish Shrivastava
Angestellt, Analog Mixed signal IC designer, Fraunhofer IIS
Halle, Deutschland
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Werdegang
Berufserfahrung von Ashish Shrivastava
Ausbildung von Ashish Shrivastava
- 3 Jahre und 11 Monate, Okt. 2012 - Aug. 2016
Micro and Nano systems
TU Chemnitz
Analog IC design, Advanced Integrated Circuit Technology, Digital IC Design, System Design (VHDL)
- 4 Jahre, Juli 2003 - Juni 2007
Electronics and Communication Engineering
Technocrats Institute of Technology
Electronic device and circuit, digital logic system, analog and digital communication, measurement and instrumentation, Digital signal processing
Sprachen
Englisch
Fließend
Deutsch
Grundlagen
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