Tejaswinee Lokare
Fähigkeiten und Kenntnisse
Werdegang
Berufserfahrung von Tejaswinee Lokare
- Current 16 years and 7 months, since Nov 2009
PhD Student
Infineon and Technical Universität München
Simulations and electrical measurements to study the dynamic stability of MOS devices Compensation
- 1 year and 1 month, Jan 2008 - Jan 2009
Development Engineer
Qimonda
Responsible for developing and maintaining the runsets for the Layout versus schematic (LVS) and parasitic resistors and capacitors (RCX). Worked on different technologies from 70nm to 35nm. Languages used Assura and Calibre.
Ausbildung von Tejaswinee Lokare
- Current 16 years and 7 months, since Nov 2009
Power Electronics
Technical Universität München
Simulations and electrical measurements to study the dynamic stability of MOS devices Compensation
- 1 year, Sep 2006 - Aug 2007
Microelectronics
University of Newcastle
VLSI design, Digital Electronics, Semiconductor Devices, Fabrication Technology, Digital Signal Processing, Data Communication.
- 3 years and 11 months, Oct 2002 - Aug 2006
Electronics and Telecommunication
Pune University
VLSI design, Electronics Design, Electronic Device and Circuits, Microprocessor Application, Digital Signal Processing, Fibre Optic Communication, Communication Engg.,
Sprachen
English
C1 (Fließend)
German
A1-A2 (Grundkenntnisse)
Hindi
Marathi
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