Albert Kobert

Angestellt, Physical Design Engineer (SoC implementation), RacyICs GmbH
Neu-Isenburg, Deutschland

Fähigkeiten und Kenntnisse

VHDL
Implementierung
Verilog
STA
Physical verification
ASIC
SoC
Formal Verification
PnR
FPGA
Linux
Tcl

Werdegang

Berufserfahrung von Albert Kobert

  • Bis heute 3 Jahre und 7 Monate, seit Jan. 2022

    Physical Design Engineer (SoC implementation)

    RacyICs GmbH
  • 6 Jahre und 4 Monate, März 2015 - Juni 2021

    Physical Design Engineer (SoC implementation)

    Socionext Europe GmbH

    - Physical implementation of block level partitions; 28nm-7nm technologies - Floorplanning, power-mesh design, CTS, P&R and ECOs - Block and chip level QoR verification; static timing analysis, physical verification, power integrity and formal verification

  • 3 Jahre und 5 Monate, Okt. 2011 - Feb. 2015

    Junior Physical Design Engineer

    Fujitsu Semiconductor Europe GmbH

    - Physical implementation of block level partitions; 28nm, 40nm and 65nm technologies

  • 5 Jahre und 7 Monate, März 2006 - Sep. 2011

    Hardwareentwickler (FPGA Design)

    bitGate data systems GmbH

    - FPGA Design (VHDL, Xilinx Virtex II Pro, Virtex 5, Spartan 3) - Embedded Programming (C on PowerPC inside Virtex II Pro) - PCB Design (small two layer boards)

Ausbildung von Albert Kobert

  • 4 Jahre und 5 Monate, Okt. 2001 - Feb. 2006

    Elektrotechnik

    FH Fulda

    Informations- und Kommunikationstechnik

Sprachen

  • Deutsch

    Muttersprache

  • Russisch

    Gut

  • Englisch

    Gut

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