Patricia Mathew

Bis 2022, ASIC Digital Design Verification Engineer, Synopsys Inc.
Abschluss: Master of Science (MS), Manipal University
Erfurt, Germany

Fähigkeiten und Kenntnisse

Functional verification
Digital logic
ASIC
Functional Coverage
System verilog
SVA
Verilog
DDR5
DDR4
Python
Debugging
Synopsys EDA

Werdegang

Berufserfahrung von Patricia Mathew

  • 10 years and 4 months, Jun 2012 - Sep 2022

    ASIC Digital Design Verification Engineer

    Synopsys Inc.

Ausbildung von Patricia Mathew

  • 2 years, Jun 2011 - May 2013

    VLSI

    Manipal University

    CGPA - 8.1/10

  • 3 years and 8 months, Oct 2006 - May 2010

    Electronics and Communication Engineering

    Mahatma Gandhi University

Sprachen

  • English

    C1 (Fließend)

  • German

    B1-B2 (Gute Kenntnisse)

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