Peter Pridnig
Werdegang
Berufserfahrung von Peter Pridnig
- Current 5 years and 10 months, since Aug 2020
Design Engineer for Analog /Mixed Signal IC
Maxlinear
- 4 years and 9 months, Nov 2015 - Jul 2020
Design Engineer for Analog / Mixed Signal IC
Intel Austria GmbH
- 2 years and 6 months, May 2013 - Oct 2015
Design Engineer Analog / Mixed Signal IC
Lantiq A GmbH
- 3 years and 6 months, Nov 2009 - Apr 2013
Design Engineer for Analog / Mixed Signal IC
Infineon
- 1 year and 4 months, Jul 2008 - Oct 2009
Design Engineer Analog / Mixed Signal IC
Grace Semiconductor
- 7 years and 6 months, Jan 2001 - Jun 2008
Senior Test Engineer
Micronas Halbleiterentwicklungs GmbH
Test concept development and lab evaluation of analog macro blocks (ADCs, DACs, PLLs, etc.) and hi-speed interfaces (HDMI)
Lab evaluation of analog and mixed-signal macro blocks, ATE test
- 8 months, Jul 1998 - Feb 1999
Student
Siemens Villach Halbleiterentwicklungs-GmbH
Diploma thesis: "Methods and Draft Standards for the Dynamic Characterization and Testing of A/D Converters"
Ausbildung von Peter Pridnig
- 6 years and 2 months, Mar 1993 - Apr 1999
Telematik
TU Graz
Microelectronics, telecommunication engineering, technical mathematics
Sprachen
English
C1 (Fließend)
Italian
B1-B2 (Gute Kenntnisse)
Croatian
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