David Salces

Angestellt, Analog-IC-Designer/ analoge Schaltungsentwicklung, ams AG
Graz, Austria

Fähigkeiten und Kenntnisse

Virtuoso Cadence
Cadence Tools
MatLab
FPGA Design
LabVIEW
Simulink
Cadence Virtuoso Layout Suite
LINUX
Verilog-AMS

Werdegang

Berufserfahrung von David Salces

  • Current 12 years and 4 months, since Feb 2014

    Analog-IC-Designer/ analoge Schaltungsentwicklung

    ams AG
  • 6 months, May 2013 - Oct 2013

    Analog-IC-Designer/ analoge Schaltungsentwicklung

    ams AG

    Design and optimization of LC oscillator core Design and optimization of CML divider stage Realization of a test-chip for design verification Evaluation and documentation of test-chip measurement results

  • 2 months, Jul 2012 - Aug 2012

    IAESTE internship

    Faculty of Electrical Engineering Prague

    Developing medical application for Android. Data processing with Matlab.

  • 8 months, Oct 2011 - May 2012

    Collaboration grant

    Centro de Tecnologias Fisicas (CTF)

    Handling of the device for taking measures. Performing calculations for taking measures. Data processing with Matlab.

  • 4 months, Jul 2011 - Oct 2011

    IAESTE internship

    Instytut Technologii Elektronowej

    Study of Ohmic Contacts. Processing of AlGaN/GaN structure for High Electron Mobility Transistors (HEMT).

Ausbildung von David Salces

  • 6 years and 6 months, Sep 2007 - Feb 2014

    Telecommunications Engineering, Dipl.-Ing Electronics

    Polytechnic University of Valencia

Sprachen

  • Spanish

    C2 (Verhandlungssicher / Muttersprachlich)

  • English

    C1 (Fließend)

  • German

    A1-A2 (Grundkenntnisse)

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