Harshita Joshi

Angestellt, Lead Design Engineer, NXP Semicondutors
Abschluss: M.Tech, Nirma University of Science and Technology
Munich, Germany

Fähigkeiten und Kenntnisse

Verilog
SystemVerilog
Unified Power Format
Static Low Power Checks
RTL Designing
Cryptography
Excel
Word
VHDL

Werdegang

Berufserfahrung von Harshita Joshi

  • Current 5 years and 2 months, since Apr 2021

    Lead Design Engineer

    NXP Semicondutors

  • 1 year and 11 months, May 2019 - Mar 2021

    Senior Design Engineer

    NXP Semicondutors

  • 1 year and 11 months, Jun 2017 - Apr 2019

    Design Engineer

    NXP Semicondutors

  • 1 year and 1 month, Jun 2016 - Jun 2017

    IC Design Engineer

    Cypress Semiconductor

  • 1 year, Jun 2015 - May 2016

    Intern

    Broadcom Ltd.

  • 6 months, Dec 2012 - May 2013

    Trainee

    ISRO

Ausbildung von Harshita Joshi

  • 2 years, Jul 2014 - Jun 2016

    VLSI Design

    Nirma University of Science and Technology

  • 3 years and 10 months, Jul 2009 - Apr 2013

    Electronics and Communication Engineering

    Charotar University of Science and Technology, Gujarat, India

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