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Harshita Joshi

Angestellt, Lead Design Engineer, NXP Semicondutors
Abschluss: M.Tech, Nirma University of Science and Technology
Munich, Deutschland

Fähigkeiten und Kenntnisse

Verilog
SystemVerilog
Unified Power Format
Static Low Power Checks
RTL Designing
Cryptography
Excel
Word
VHDL

Werdegang

Berufserfahrung von Harshita Joshi

  • Bis heute 4 Jahre und 3 Monate, seit Apr. 2021

    Lead Design Engineer

    NXP Semicondutors

  • 1 Jahr und 11 Monate, Mai 2019 - März 2021

    Senior Design Engineer

    NXP Semicondutors

  • 1 Jahr und 11 Monate, Juni 2017 - Apr. 2019

    Design Engineer

    NXP Semicondutors

  • 1 Jahr und 1 Monat, Juni 2016 - Juni 2017

    IC Design Engineer

    Cypress Semiconductor

  • 1 Jahr, Juni 2015 - Mai 2016

    Intern

    Broadcom Ltd.

  • 6 Monate, Dez. 2012 - Mai 2013

    Trainee

    ISRO

Ausbildung von Harshita Joshi

  • 2 Jahre, Juli 2014 - Juni 2016

    VLSI Design

    Nirma University of Science and Technology

  • 3 Jahre und 10 Monate, Juli 2009 - Apr. 2013

    Electronics and Communication Engineering

    Charotar University of Science and Technology, Gujarat, India

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