Dr. Jakob Lechner
Angestellt, FPGA Design Engineer, Riedel Communications Austria GmbH
Vienna, Austria
Fähigkeiten und Kenntnisse
Werdegang
Berufserfahrung von Jakob Lechner
- Current 7 years, since Jun 2019
FPGA Design Engineer
Riedel Communications Austria GmbH
- 5 years and 5 months, Jan 2014 - May 2019
FPGA/ASIC Design Engineer
RUAG Space GmbH
FPGA/ASIC Design&Verification
- 7 months, Mar 2013 - Sep 2013
Gastforscher
Newcastle University
- 4 years and 1 month, Feb 2009 - Feb 2013
Universitäts-/Projektassistent
TU Wien, Institut für technische Informatik
- 11 months, Mar 2008 - Jan 2009
Linux Software Engineer
appl.strudl Software GmbH (Fabasoft Gruppe)
- 1 year and 7 months, Aug 2006 - Feb 2008
Linux Software Engineer
Fabalabs Software GmbH (Fabasoft Gruppe)
Ausbildung von Jakob Lechner
- 5 years and 4 months, Mar 2009 - Jun 2014
Technische Informatik
Technische Universität Wien
- 4 years and 7 months, Oct 2002 - Apr 2007
Software Engineering
Technische Universität Wien
- 6 years and 3 months, Oct 2002 - Dec 2008
Technische Informatik
Technische Universität Wien
Sprachen
English
C1 (Fließend)
German
C2 (Verhandlungssicher / Muttersprachlich)
French
B1-B2 (Gute Kenntnisse)
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