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Ing. Mohammad Saad Areeb

Angestellt, ASIC Design Engineer, Apple
Stuttgart, Deutschland

Fähigkeiten und Kenntnisse

IC design
Matlab-Programmierung
Shell Scripting
Cadence Virtuoso
Agilient ADS
Layoutentwurf (Elektrotechnik)
Schaltungstechnik
ASIC
Simulink
analog design
RF design
Tapeout
Layout
C++
Sonnet EM SImulation
Circuit design
RFIC
Design

Werdegang

Berufserfahrung von Mohammad Saad Areeb

  • Bis heute 3 Jahre und 3 Monate, seit März 2022

    ASIC Design Engineer

    Apple
  • 3 Jahre und 6 Monate, Sep. 2018 - Feb. 2022

    Analog Design Engineer

    Texas Instruments

  • 6 Monate, März 2018 - Aug. 2018

    Master Thesis

    Technische Universität Dresden

    Entwurf des Vector Modulator für Multi-Band Bewerbung von 28 und 38 GHz für eine Beamformer in 5G.

  • 7 Monate, Okt. 2017 - Apr. 2018

    Studentische Hilfskraft

    Fraunhofer IIS, Institutsteil Entwicklung Adaptiver Systeme EAS

    Entwurf eines abstimmbaren spannungsgesteuerten Oszillators in GF-22nm FDSOI von 58-65 GHz. - Entwurf von Schmatisch Ebene - Layout auch von der ganzer Schaltung - Gemacht Post-layout Simulation auch

  • 3 Monate, Okt. 2017 - Dez. 2017

    Studentische Hilfskraft

    Technische Universität Dresden

    - Entwurf und Layout machen von viele Schaltung, z.B. Mixer, Amplifier - EM Simulation in der Sonnet Simulator

  • 5 Monate, Mai 2017 - Sep. 2017

    Praktikant

    Fraunhofer IIS, Institutsteil Entwicklung Adaptiver Systeme EAS

    Entwurf eines abstimmbaren spannungsgesteuerten Oszillators in GF-22nm FDSOI von 58-65 GHz. - Entwurf von Schmatisch Ebene - Layout auch von der ganzer Schaltung - Gemacht Post-layout Simulation auch

  • 4 Monate, Jan. 2017 - Apr. 2017

    Studentische Hilfskraft

    Technische Universität Dresden

    - Entwurf und Layout machen von Distributed Ultra Wideband Amplifier - EM Simulation in der Sonnet Simulator

  • 9 Monate, Aug. 2016 - Apr. 2017

    Studentische Hilfskraft

    Fraunhofer IIS, Institutsteil Entwicklung Adaptiver Systeme EAS

    System modelling of RF circuit parts 1. Modelling and Analysis of a PLL in MATLAB and Simulink 2. Modelling of a mixer in MATLAB and Simulink

  • 4 Monate, Juni 2015 - Sep. 2015

    Trainee

    Synopsys India Pvt. Ltd.

    Design Automation and Scripting for the IP Design Verification Team

Ausbildung von Mohammad Saad Areeb

  • 2 Jahre und 11 Monate, Okt. 2015 - Aug. 2018

    Nanoelectronic Systems

    Technische Universitat Dresden

    GPA - 1.7

  • 3 Jahre und 11 Monate, Juli 2011 - Mai 2015

    Elektrotechnik/ Kommunikation Engineering

    Jamia Millia Islamia

    CGPA - 9.35/10 ( 1.3 in German scale)

  • 2 Jahre, Juli 2009 - Juni 2011

    Wissenschaftsforschung

    Jamia Millia Islamia

    Ergebnis - 86.2 %

Sprachen

  • Deutsch

    Grundlagen

  • Englisch

    Fließend

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