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Ing. Preeta Katiyar

is looking for a new team member.

Angestellt, RTL Design And Verification Engineer, Sipearl GMBH
Aschaffenburg, Deutschland

Fähigkeiten und Kenntnisse

Physical Design
Verilog VHDL
8085 and 8086 series
8051 Microcontroller
Digital electronics
Digital integrated circuit and designing
ASIC Design
Analog Mixed Signal Design
Analog Layout Design
Memory Design
C
C++
Xilink/ISE
Virtusoo/XL/ADE Cadence
ASIC PLD FPGA Digital Logic Design
Embedded Systems
ARM Architecture
Embedded / Real-Time / RTOS
Embedded Software Development
Embedded Linux
Embedded System Development
Mikrocontroller
Electrical Engineering
Debian GNU/Linux
Ethernet
CANalyzer
CAnop
Lin
I2C
Python
Linux
Hardware
Git
IC Design
Microelectronics

Werdegang

Berufserfahrung von Preeta Katiyar

  • Bis heute 3 Jahre und 2 Monate, seit Juni 2022

    RTL Design And Verification Engineer

    Sipearl GMBH

  • 11 Monate, Juli 2013 - Mai 2014

    Research Trainee

    IIT Kanpur

    Position: Research Trainee Project in Brief: Design and Implementation of 32 Bit Carry Look-Ahead Adder Using 180 nm CMOS Technology

Ausbildung von Preeta Katiyar

  • 2 Jahre, Juli 2012 - Juni 2014

    Microelectronics

    Banasthali Vidyapith

    VLSI Design

  • 4 Jahre und 1 Monat, Juni 2006 - Juni 2010

    Electronics and Communication Engineering

    Rajasthan Technical University

    Electronics and Communication Engineering

Sprachen

  • Englisch

    Fließend

  • Deutsch

    Fließend

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