Vijay Karthik Kalyanasundaram
Fähigkeiten und Kenntnisse
Werdegang
Berufserfahrung von Vijay Karthik Kalyanasundaram
- Bis heute 6 Jahre und 10 Monate, seit Dez. 2018
IC layout engineer
Gesellschaft für Mikroelekronik Entwicklungen mbH
Layout design for semi-custom IC designs
- 1 Jahr und 4 Monate, Feb. 2017 - Mai 2018
Thesis Research assistant
Institut für Elektriche und Optische Nachrichtentechnik
Design of a High speed clock regeneration circuit for a 128 GS/s Analog Demultiplexer using B11HFC technologies in Cadence Virtuoso platform. Design involves base level transistor design throughout the entire block design including back end checks with adequate gain, minimal power consumption and maximum bandwidth.
- 8 Monate, Mai 2016 - Dez. 2016
Digital design engineer
eesy-ic GmbH
Testing and verification of a Digital Down Converter (DDC) block within AD9625, a 12-bit monolithic sampling analog-to-digital converter in VHDL platform Design of components for All Digital Phased Locked Loop (ADPLL) in VHDL platform Characterisation of an Applied Specific Integrated Circuit (ASIC) in laboratory
Flashing the ECUs, updating the results in DOORS and working with metrics in remote parking assistance
Ausbildung von Vijay Karthik Kalyanasundaram
- 3 Jahre und 7 Monate, Okt. 2014 - Apr. 2018
Micro and Optoelectronics
University of Stuttgart
IC design, Analog Circuits design, Mixed Signal Circuits design, ASIC design, FPGA's and CPLDs, Microelectronics, Digital System Design, Optoelectronic circuits and devices, Advanced CMOS devices and circuits
Sprachen
Englisch
Muttersprache
Deutsch
Gut
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