Vishwas Ravishankar

Bis 2024, Digital Verification Intern, STMicroelectronics
Grenoble, Frankreich

Fähigkeiten und Kenntnisse

Verilog
Python
Cadence
Digital electronics
Verification
Digital Design
ASIC
Xilinx Vivado
Embedded Systems
UVM
SystemVerilog
Electronics
IC Design
Tcl
Team work
Communication skills
Cadence Xcelium
Cadence vManager
RTL Design
SoC Design

Werdegang

Berufserfahrung von Vishwas Ravishankar

  • 7 Monate, Juni 2024 - Dez. 2024

    Digital Verification Intern

    STMicroelectronics

  • 8 Monate, Feb. 2023 - Sep. 2023

    Research and Development Intern

    ABB

Ausbildung von Vishwas Ravishankar

  • 2 Jahre und 1 Monat, Feb. 2022 - Feb. 2024

    VLSI Design and Embedded Systems

    R.V. College of Engineering

  • 2 Jahre und 1 Monat, Feb. 2022 - Feb. 2024

    VLSI Design and Embedded Systems

    R.V. College of Engineering

  • 4 Jahre und 4 Monate, Aug. 2017 - Nov. 2021

    Electrical and Electronics Engineering

    University Visvesvaraya College of Engineering

Sprachen

  • English

    Muttersprache

  • Hindi

    Fließend

  • Kannada

    Muttersprache

  • Französisch

    Grundlagen

  • Deutsch

    Grundlagen

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