Alexander Dillmann

Angestellt, ASIC Engineer, Ciena
Braunschweig, Germany

Fähigkeiten und Kenntnisse

Universal Verification Methodology
SystemVerilog
RTL design (ASIC FPGA)
Specman e
SystemC

Werdegang

Berufserfahrung von Alexander Dillmann

  • Current 10 months, since Aug 2025

    ASIC Engineer

    Ciena

  • 5 years and 9 months, Nov 2019 - Jul 2025

    Lead Engineer Frontend design

    Coherent Corp. / Finisar Germany GmbH

  • 2 years and 8 months, Feb 2017 - Sep 2019

    Senior Design Engineer

    Socionext Europe GmbH

  • 7 years, Feb 2010 - Jan 2017

    Digital Design Engineer

    Dream Chip Technologies GmbH

  • 6 years and 9 months, May 2003 - Jan 2010

    Senior Design Engineer

    Silicon Image GmbH

Ausbildung von Alexander Dillmann

  • 6 years and 4 months, Oct 1996 - Jan 2003

    Elektrotechnik

    Universität Hannover

    Mikroelektronik

Sprachen

  • German

    C2 (Verhandlungssicher / Muttersprachlich)

  • English

    C1 (Fließend)

  • Russian

    B1-B2 (Gute Kenntnisse)

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